1. 메모리 맵 구성
- control 레지스터
- state 레지스터
- read 레지스터
- write 레지스터
- 메모리 ( 48bits * 32)
- 메모리 ( 48bits * 32)
- 메모리 (8bits * 2560 )
- 메모리 (8bits * 2560 )
2. 버스 인터페이스 설계
- 103개의 I/O
- 16bit 데이터
- 20bit 어드레스
3. 레지스터 파일 설계
- MAC 의 I/O 에서 메모리 I/O 제외
4. 어드레스 디코더 설계
- 20bit 어드레스를 이용해서 메모리와 레지스터 접근
5. 4가지 시나리오에 대한 테스트 벡터 작성
6. FPGA와 ARM 을 이용한 에뮬레이션
7. 컨퍼런스 논문
8. PHY 와 연동을 위한 Tx 인터페이스 변경
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