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  1. 2008/06/23 MPW 종료~
  2. 2008/06/05 정답이 없네,, (3)
  3. 2006/07/07 전공관련 용어 정리
STUDY/전공2008/06/23 14:08

MPW 종료~

드디어 고생의 끝이 보이기 시작했다

가장 큰 고비였던 MPW를 잘 마쳤다. 후후

그지같은 매그나칩 테크때문에 개고생한걸 생각하면 으~~

공정을 0.35로 하지 않았으면 설계한 로직을 FULL 로 넣을 수 있었을 텐데 하는 아쉬움과 미련이 남지만

나중에 또 해보면 되는거니까... 이미 한번 경험 했으니 그걸로 됐다고 위로하고

이제 설계할 2차버전에서는 0.18 공정으로 해보면 되지뭐

그나저나 칩이 나오면 잘 동작 하려나 ㅋ.,ㅋ

뭐 나름대로 참 이쁘게 나온것 같다

LAYOUT


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Posted by 영고니짱
TAG asic, layout, MPW, 매그너공정
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STUDY/전공2008/06/05 00:44

정답이 없네,,

버퍼 열심히 노가다로 netlist 에 300개씩 넣었더니

아스트로 타이밍 돌리니까 slack 이 - 나온다. 4ns 딜레이 버퍼넣엇는데 7ns 걸리는건 무슨경우?

innterconnect delay 0 로 놓구 했는데 크크...결국 딜레이를 빼고 다시 첨부터 도전...이거 뭔 시간도 부족한데

어ㅉㅓ라는건지..delay 를 추가할때는 fanout 을 고려해야하는데 그런것도 모르고 했더니..fanout 으로 인한

딜레이가 엄청나군...

input delay 와 output delay 는 대략 동작 주파수의 15% 마진으로 설정.

RTL 에서 pad top 을 추가하지말고 합성된 net-list 에 pad top 을 추가하는것이 더 유용하다

특히 PRE-layout simulation 의 경우는 pad 딜레이가 정확하지 않으므로 애초에 pad 딜레이를 제외한

로직의 top 모듈로 테스트를 하고 astro 로 갈때 pad net-list를 가지고 가서 p&r 하는것이 유리.

파워링과 패드 사이의 딜레이는 공정사 에서 제공해준 METAL 레이어의 간격 만큼만 두면되기때문에

가급적 패드와 파워링을 가까이 두고 코어와 파워링 사이도 라우팅 공간을 할당하는것이 유리

파워링의 두께는 코어사이즈의 1%이상으로 설정.


위 모든 테크닉은 말 그대로 꽁수.. 테크닉임..정답이 아님..

진정한 back-end 엔지니어는 엄청 꼼꼼하고 차분한 성격일꺼야...아....힘들어 적성에 안맞나? ㅋ.,ㅋ

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Posted by 영고니짱
TAG asic, back-end, MPW
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STUDY/전공2006/07/07 13:22

전공관련 용어 정리

IEEE (Institute of Electrical and Electronics Engineers)
HDL (Hardware Description Language)
FPGAs (Field Programmable Gate Arrays)
ASICs (Application Specific Integrated Circuits)


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